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Verilog、SystemVerilog、SystemCなど、ハードウェア記述言語についてのブログです。

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HCE

EDA Design Guidelineのこの記事で、イタリアのYlichronという会社がANSI-Cから
VHDLを生成できる動作合成ツールをリリースしたと書かれています。
ターゲットはFPGA向けとのことです。
VisualStudioと統合されていて、C言語のソースを変えずにVHDLに落とせるそうです。
会社のホームページからは試用版をダウンロードできるようです。

ANSI-CからRTLを生成するという点ではImpulseC/CoDeveloperと同じですね。
確かForteもFPGA向けのCynthesizerをリリースするというニュースが今年あった
と記憶していますが、FPGA向けの動作合成も本格化してくるのかもしれません。

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